vhdl模块化设计
时间：10-02
整理：3721RD
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我在写VHDL程序的时候，分成几个模块，可是最后怎么完成顶层设计?
block里，将你的模块连接到一起去
写完你的顶层程序，在你的文件上右键
谢谢大侠的相告