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关于memory clock p和N之间的电容
时间:10-02
整理:3721RD
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想问一下在Memory的设计中,关于CKP和CKN之间一般有个3.3pf的小电容,这个是什么原理呢? 大家探讨一下,
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hyperlynx仿真时候提示at least one plane layer is required
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仿真时总是出现这样的错误。
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