关于HDL导网表时候的问题
时间：10-02
整理：3721RD
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小弟在导网表的时候，原理图单独打包都没有问题，可是update pcb这一步会出现error，问题在图片，有没有各位大师遇到过或者知道这是什么情况，小弟在此感激不尽
就是在这一步遇到的问题，一直在纠结这个问题， 望各位前辈有遇到货晓得问题出在哪，小弟感激不尽，谢谢
原理图打包时勾选下图中的选项。
这个好像点不了，是灰色的，我一开始也以为是这个问题，后来发现不是这里的问题
请点击一下update pcb,再点.